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光收發(fā)芯片是光收發(fā)模塊中的集成電路，并不包括激光芯片，是指光纖寬帶網(wǎng)絡(luò)物理層的主要基礎(chǔ)芯片，包括跨阻放大器、限幅放大器、激光驅(qū)動器三種。它們被用于光纖傳輸?shù)那岸耍瑏韺崿F(xiàn)高速傳輸信號的光電、電光轉(zhuǎn)換，這些功能被集成在光纖收發(fā)模塊中。

圍繞自主通用處理器，研發(fā)操作系統(tǒng)及其之上的核心 API 軟件，支撐國家信息化建設(shè)，并致力于構(gòu)建區(qū)別于 Wintel 和 AA 之外的世界第三套信息化生態(tài)體系 。

產(chǎn)品詳細介紹 　　概述： 　　1.0625Gbps至4.25Gbps單芯片集成的低功耗SFP+多速率限幅 　　放大器和VCSEL驅(qū)動器高速光收發(fā)芯片(EP110) 　　EP110為高度集成的限幅放大器和VCSEL驅(qū)動器，設(shè)計用于數(shù)據(jù)傳輸速率高達8.5Gbps的1x/2x/4x/8x光纖通道傳輸系統(tǒng)以及10.3125Gbps數(shù)據(jù)傳輸速率的10GBASE-SR傳輸系統(tǒng)。器件采用+3.3V單電源供電，這款低功耗、集成限幅放大器、VCSEL驅(qū)動器和微控制器三合一的高集成單芯片。平均光功率由平均功率控制環(huán)路(APC)控制，該控制環(huán)路通過連接至VCSEL驅(qū)動器的3線數(shù)字接口控制、所有差分I/O為50歐姆傳輸線PCB設(shè)計提供最佳的背板短接。EP110集成一個微處理器，可以實現(xiàn)SFF8472協(xié)議的數(shù)字監(jiān)控接口要求，可通過固件實現(xiàn)高級Rx設(shè)置(模式選擇、LOS門限、LOS極性、CML輸出電平、信號通道極性)和Tx設(shè)置(調(diào)制電流、偏置電流、極性、眼圖交叉點調(diào)制)，無需外部微處理器和外部元件。 　　EP110采用無鉛、5mm*5mm、40引腳QFN封裝。 　　1.0625Gbps至10.32Gbps單芯片集成的低功耗SFP+多速率限幅 　　放大器和VCSEL驅(qū)動器高速光收發(fā)芯片(EP112) 　　EP112為高度集成的限幅放大器和VCSEL驅(qū)動器，設(shè)計用于數(shù)據(jù)傳輸速率高達8.5Gbps的1x/2x/4x/8x光纖通道傳輸系統(tǒng)以及10.3125Gbps數(shù)據(jù)傳輸速率的10GBASE-SR傳輸系統(tǒng)。器件采用+3.3V單電源供電，這款低功耗、集成限幅放大器、VCSEL驅(qū)動器和微控制器三合一的高集成單芯片。平均光功率由平均功率控制環(huán)路(APC)控制，該控制環(huán)路通過連接至VCSEL驅(qū)動器的3線數(shù)字接口控制、所有差分I/O為50歐姆傳輸線PCB設(shè)計提供最佳的背板短接。EP112集成一個微處理器，可以實現(xiàn)SFF8472協(xié)議的數(shù)字監(jiān)控接口要求，可通過固件實現(xiàn)高級Rx設(shè)置(模式選擇、LOS門限、LOS極性、CML輸出電平、信號通道極性)和Tx設(shè)置(調(diào)制電流、偏置電流、極性、眼圖交叉點調(diào)制)，無需外部微處理器和外部元件。 　　EP112采用無鉛、5mm*5mm、40引腳QFN封裝。 　　1.0625Gbps至14Gbps單芯片集成的低功耗SFP+多速率限幅 　　放大器和VCSEL驅(qū)動器高速光收發(fā)芯片(EP116) 　　EP116是一款低功耗、集成限幅放大器、VCSEL驅(qū)動器和微控制器三合一的16G SFP+高集成高速光收發(fā)芯片,工作在高達14Gbps的數(shù)據(jù)速率、非常適合以太網(wǎng)和光纖通道應(yīng)用。在EP116的發(fā)射和接收路徑上集成了CDR功能，解決了大多數(shù)高速系統(tǒng)存在的信號失真問題。平均光功率由平均功率控制環(huán)路(APC)控制，該控制環(huán)路通過連接至VCSEL驅(qū)動器的3線數(shù)字接口控制、所有差分I/O為50歐姆傳輸線PCB設(shè)計提供最佳的背板短接。EP116集成一個微處理器，可以實現(xiàn)SFF8472協(xié)議的數(shù)字監(jiān)控接口要求，可通過固件實現(xiàn)高級Rx設(shè)置(模式選擇、LOS門限、LOS極性、CML輸出電平、信號通道極性、去加重)和Tx設(shè)置(調(diào)制電流、偏置電流、極性、可編程去加重、眼圖交叉點調(diào)制)，無需外部微處理器和外部元件。 　　EP116采用無鉛、6mm*6mm、48引腳QFN封裝。 　　特點： 　　3.3供電時，功耗僅為500mW 　　工作速率高達10.32Gbps 　　10.32Gbps下，具有5mVp-p接收靈敏度 　　Rx和Tx極性選擇 　　可調(diào)節(jié)觸發(fā)LOS報警電平 　　LOS極性選擇 　　能夠向100歐姆差分負載提供高達12mA的調(diào)制電流 　　偏置電流高達19mA 　　Rx輸出可選擇去加重 　　支持SPI EEPROM和IIC EEPROM 　　可調(diào)節(jié)調(diào)制輸出的眼圖交叉點 　　工作溫度: -40度 到 90度

目前，多媒體視頻領(lǐng)域存在多個編碼標(biāo)準，包括 mpeg1/mpeg2/mpeg4/h.264，以及我們國家擁有自主知識產(chǎn)權(quán)的 AVS 標(biāo)準。mpeg4 標(biāo)準之中又包括 xvid、divx 等，而 h.264 可能 93 合作方式 商談。4 所屬行業(yè)領(lǐng)域 電子信息領(lǐng)域。也將存在多種編碼標(biāo)準。其中新的編碼標(biāo)準，如 h.264、VC-1 等，由于其需要較高的處理能 力，僅僅依靠嵌入式 CPU 或 DSP 的多媒體解決方案是無法獲得滿意的性能指標(biāo)的，因此必 須采用專用集成電路(ASIC)方法來實現(xiàn)硬件加速功能。但這種 ASIC 設(shè)計方法——即通過硬件實現(xiàn)直接提供某種(些)編碼格式的支持缺乏靈 活性，一旦有種新的編碼標(biāo)準推出，就需要重新設(shè)計開發(fā)芯片。面對眾多的媒體編碼標(biāo)準， 這種方式增加了設(shè)計以及應(yīng)用成本。而就目前市場發(fā)展來看，多種視頻編解碼技術(shù)將長期共 存，迫使芯片業(yè)界必須迅速攻克靈活性、兼容性等難題。為解決這一問題，清華大學(xué)設(shè)計了 一種軟硬件混合的多媒體處理器解決方案，支持 mpeg1/mpeg2/mpeg4 /h.264/AVS 視頻標(biāo)準 以及相關(guān)的音頻編碼標(biāo)準。其核心是設(shè)計一種多媒體處理芯片，該芯片對于通用的多媒體編 碼中的計算密集型的數(shù)據(jù)處理，如運動補償算法(Motion Compensation)、反離散余弦變化 (iDCT)、色彩空間轉(zhuǎn)換等，采用 ASIC 實現(xiàn)。在此硬件平臺之上，設(shè)計一套與具體標(biāo)準無 關(guān)的多媒體處理通用軟件開發(fā)接口，實現(xiàn)軟硬件混合的媒體處理。這樣就能夠增加媒體處理 的靈活性——可以通過修改軟件來支持新的編碼標(biāo)準或者新的應(yīng)用。

面向客戶的嵌入式系統(tǒng)應(yīng)用要求，采用0.25um工藝，設(shè)計主頻100MHz以上專用的嵌入式微處理器SoC芯片：32位嵌入式微處理器芯片——SEP3201、高性能32位嵌入式微處理器芯片——眾志805、基于ARM內(nèi)核的32位嵌入式微處理器芯片——Garfield2、Garfield3、Garfield4、Garfield5，如圖所示。

本發(fā)明公開了一種安全存儲器芯片、系統(tǒng)及其認證方法；該安 全存儲器芯片包括總線接口模塊、存儲器模塊、控制模塊、加密模塊 和私鑰；控制模塊和存儲器模塊共用一個總線接口模塊，加密模塊和 存儲器模塊均與控制模塊相連，私鑰與加密模塊相連；存儲器模塊的 存儲區(qū)域包括通用區(qū)域和受保護區(qū)域，通用區(qū)域用于存儲軟件程序， 受保護區(qū)域用于存儲敏感數(shù)據(jù)；公鑰存儲于通用區(qū)域內(nèi)。本發(fā)明提供 的安全存儲器芯片具備更高的安全性；安全存儲器芯片中的存

基于事件驅(qū)動方式的仿生視覺圖像傳感器，用于高速場景的拍攝 一、項目分類 關(guān)鍵核心技術(shù)突破、顯著效益成果轉(zhuǎn)化 二、成果簡介 隨著虛擬現(xiàn)實（VR）、增強現(xiàn)實（AR）和混合虛擬增強現(xiàn)實（MR）技術(shù)、自動駕駛、物聯(lián)網(wǎng)以及機器視覺等領(lǐng)域的飛速發(fā)展，對圖像傳感器的采集速度提出了更高的要求。傳統(tǒng)基于“幀”掃描形式的CMOS 或 CCD 圖像傳感器較難滿足高速運動物體的拍攝需求，若提高相機的圖像采集幀率，則需要采用高性能且結(jié)構(gòu)復(fù)雜的模數(shù)轉(zhuǎn)換器，大量的圖像會帶來較大的數(shù)據(jù)冗余，此外，也會面臨功耗高的問題。 相比于傳統(tǒng)的光電和圖像傳感器，生物視網(wǎng)膜具有許多不可比擬的優(yōu)勢。視網(wǎng)膜中的光感受器可根據(jù)外界光強的變化自適應(yīng)調(diào)節(jié)增益，能夠感知超過 180dB 的光強范圍。另外，視網(wǎng)膜基于事件驅(qū)動式的采集方式，僅輸出場景中光強發(fā)生變化的信息，因而，能夠濾除低頻信息帶來的冗余。在信號處理和傳輸上，采用異步通信的方式，通過神經(jīng)節(jié)細胞將光強信息轉(zhuǎn)換為時空脈沖信號，實現(xiàn)低功耗。 受到生物視網(wǎng)膜的啟發(fā)，研究人員提出了基于事件驅(qū)動方式的仿生視覺圖像傳感器，用于高速場景的拍攝。該類傳感器多采用對數(shù)像素電路作為光強探測單元，因其動態(tài)響應(yīng)范圍寬，可隨機讀取。然而，對數(shù)電路在弱光環(huán)境下靈敏度低，幾乎沒有光響應(yīng)，即仍然無法模仿視網(wǎng)膜弱光下的高靈敏度，除此之外，其輸出受到 (Fixed Pattern Noise，F(xiàn)PN)的影響，降低了圖像質(zhì)量。 我們提出了一種兼容 CMOS 工藝的光敏二極管體偏置場效應(yīng)晶體管器件(PD- body biased MOSFET，簡稱 PD-MOS)，其結(jié)構(gòu)圖和等效電路如圖 1所示。 利用 PD 的感光特性以及 MOSFET 的正向襯底偏置效應(yīng)實現(xiàn)集成光強探測及信號放大于一體的光電器件。該器件可解決對數(shù)電路在弱光下靈敏度低的問題，并且提出了一種明暗傳感器的方案以降低噪聲。設(shè)計成像測試方案并搭建靜態(tài)圖像采集測試系統(tǒng)，實現(xiàn)靜態(tài)顯示，通過 MTALAB 進行圖像恢復(fù)從而實現(xiàn)動態(tài)圖像顯示功能。   圖 1 (a) PD-MOS 器件結(jié)構(gòu)及其 (b) 等效電路圖 經(jīng)過商用 180nm CMOS 工藝流程制備后的器件概貌如圖 2 所示，圖 (a) 為三種不同像素設(shè)計的芯片實物圖，從上至下分別為環(huán)形結(jié)構(gòu)、條形結(jié)構(gòu)及對數(shù)像素電路，將其中的環(huán)形結(jié)構(gòu)在顯微鏡下放大觀察可看到圖 (b) 所示的形貌，圖 (c) 為4個像素的顯微圖。   圖 2 (a) PD-MOS 成像陣列芯片的實物圖，(b) 環(huán)形結(jié)構(gòu)芯片在顯微鏡下的放大圖以及 (c) 環(huán)形結(jié)構(gòu)像素放大圖 上位機實時顯示效果如圖3所示，可以明顯看出兩根頭發(fā)相交。子圖 (a) 為暗態(tài)時的 100 幀平均灰度圖，子圖 (b) 為暗態(tài)時的曲面圖，子圖 (c) (e) (g) (i) 為光態(tài)下的圖，子圖 (d) (f) (h) (j) 為光態(tài)下的圖像數(shù)據(jù)減去暗態(tài)下圖像數(shù)據(jù)的降噪圖，可以發(fā)現(xiàn)在30nw/cm2 輻照度下已經(jīng)出現(xiàn)頭發(fā)的輪廓，當(dāng)輻照度繼續(xù)增加，頭發(fā)的輪廓越來越清晰，當(dāng)輻照度達到 3mw/cm2，仍然可以看到頭發(fā)的輪廓。   圖 3 陣列芯片采集的圖像 不同于傳統(tǒng)計算機視覺系統(tǒng)的圖像采集方式，生物視覺系統(tǒng)的成像由視野場景中發(fā)生的事件觸發(fā)，且生物視網(wǎng)膜具有寬動態(tài)響應(yīng)范圍、超低功耗以及異步傳輸?shù)忍攸c，這為仿生視覺系統(tǒng)的研究提供了全新的思路。隨著物聯(lián)網(wǎng)、自動駕駛以及安防等領(lǐng)域的快速發(fā)展，它們對高速動態(tài)圖像傳感器的需求也日益提升。近些年，針對這些需求，研究人員提出了一種用于采集高速動態(tài)信息的類視網(wǎng)膜相機，成為了一大熱點研究方向。類視網(wǎng)膜相機的工作原理模擬了生物視網(wǎng)膜事件驅(qū)動型的采集方式及異步型的傳輸模式，為動態(tài)視覺成像提供了硬件基礎(chǔ)。綜上，該類傳感器的研究具有十分重要的科研意義和深遠的經(jīng)濟價值。

本項目重點研究面向物聯(lián)網(wǎng)極低功耗微控制器關(guān)鍵技術(shù)，包括寬電壓標(biāo)準單元和片上存儲器設(shè)計技術(shù)、工藝-電壓-溫度（PVT）偏差檢測技術(shù)與自適應(yīng)動態(tài)電壓和頻率調(diào)節(jié)技術(shù)、快速響應(yīng)的寬負載高效率電源轉(zhuǎn)換技術(shù)、低功耗高精度模數(shù)轉(zhuǎn)換電路設(shè)計技術(shù)、極低功耗快速啟動晶體振蕩器技術(shù)；面向工業(yè)控制微控制器關(guān)鍵技術(shù)，包括高可靠處理器架構(gòu)、低延時訪問存儲策略、納秒級中斷響應(yīng)處理技術(shù)、容錯型自糾錯SRAM 設(shè)計技術(shù)、高精度時鐘基準電路設(shè)計技術(shù)。

本技術(shù)成果涉及集成電路測試技術(shù)領(lǐng) 域，公開了一種RFID讀寫器芯片中測系 統(tǒng)及方法

本項目是用 28 納米 FPGA 器件實現(xiàn)了一枚《萬兆網(wǎng)絡(luò)多核處理器》SOC 芯 片。該芯片目標(biāo)客戶是路由器、交換機、防火墻網(wǎng)絡(luò)設(shè)備整機廠商和網(wǎng)絡(luò)技術(shù) 科研、監(jiān)管機構(gòu)。該芯片用于拓展網(wǎng)絡(luò)帶寬到 10Gbps，支持 Open Flow 協(xié)議， 兼容 IPV4/IPV6 協(xié)議，是 SDN 控制器的基礎(chǔ)載體，NFV 的運行平臺。該芯片是 互聯(lián)網(wǎng)產(chǎn)業(yè)的核心器件、重要的戰(zhàn)略物資，國內(nèi)空白，國家急需。該項目的產(chǎn) 業(yè)化包含 SOC 芯片推廣，F(xiàn)PGA→ASIC 轉(zhuǎn)化、網(wǎng)絡(luò)設(shè)備整機生產(chǎn) 3 部分。適合 創(chuàng)辦的企業(yè)為 Fabless 模式集成電路芯片設(shè)計為主和網(wǎng)絡(luò)裝備整機生產(chǎn)為輔的電 43 子信息類股份制高科技企業(yè)。