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產品詳細介紹 　　概述： 　　1.0625Gbps至4.25Gbps單芯片集成的低功耗SFP+多速率限幅 　　放大器和VCSEL驅動器高速光收發芯片(EP110) 　　EP110為高度集成的限幅放大器和VCSEL驅動器，設計用于數據傳輸速率高達8.5Gbps的1x/2x/4x/8x光纖通道傳輸系統以及10.3125Gbps數據傳輸速率的10GBASE-SR傳輸系統。器件采用+3.3V單電源供電，這款低功耗、集成限幅放大器、VCSEL驅動器和微控制器三合一的高集成單芯片。平均光功率由平均功率控制環路(APC)控制，該控制環路通過連接至VCSEL驅動器的3線數字接口控制、所有差分I/O為50歐姆傳輸線PCB設計提供最佳的背板短接。EP110集成一個微處理器，可以實現SFF8472協議的數字監控接口要求，可通過固件實現高級Rx設置(模式選擇、LOS門限、LOS極性、CML輸出電平、信號通道極性)和Tx設置(調制電流、偏置電流、極性、眼圖交叉點調制)，無需外部微處理器和外部元件。 　　EP110采用無鉛、5mm*5mm、40引腳QFN封裝。 　　1.0625Gbps至10.32Gbps單芯片集成的低功耗SFP+多速率限幅 　　放大器和VCSEL驅動器高速光收發芯片(EP112) 　　EP112為高度集成的限幅放大器和VCSEL驅動器，設計用于數據傳輸速率高達8.5Gbps的1x/2x/4x/8x光纖通道傳輸系統以及10.3125Gbps數據傳輸速率的10GBASE-SR傳輸系統。器件采用+3.3V單電源供電，這款低功耗、集成限幅放大器、VCSEL驅動器和微控制器三合一的高集成單芯片。平均光功率由平均功率控制環路(APC)控制，該控制環路通過連接至VCSEL驅動器的3線數字接口控制、所有差分I/O為50歐姆傳輸線PCB設計提供最佳的背板短接。EP112集成一個微處理器，可以實現SFF8472協議的數字監控接口要求，可通過固件實現高級Rx設置(模式選擇、LOS門限、LOS極性、CML輸出電平、信號通道極性)和Tx設置(調制電流、偏置電流、極性、眼圖交叉點調制)，無需外部微處理器和外部元件。 　　EP112采用無鉛、5mm*5mm、40引腳QFN封裝。 　　1.0625Gbps至14Gbps單芯片集成的低功耗SFP+多速率限幅 　　放大器和VCSEL驅動器高速光收發芯片(EP116) 　　EP116是一款低功耗、集成限幅放大器、VCSEL驅動器和微控制器三合一的16G SFP+高集成高速光收發芯片,工作在高達14Gbps的數據速率、非常適合以太網和光纖通道應用。在EP116的發射和接收路徑上集成了CDR功能，解決了大多數高速系統存在的信號失真問題。平均光功率由平均功率控制環路(APC)控制，該控制環路通過連接至VCSEL驅動器的3線數字接口控制、所有差分I/O為50歐姆傳輸線PCB設計提供最佳的背板短接。EP116集成一個微處理器，可以實現SFF8472協議的數字監控接口要求，可通過固件實現高級Rx設置(模式選擇、LOS門限、LOS極性、CML輸出電平、信號通道極性、去加重)和Tx設置(調制電流、偏置電流、極性、可編程去加重、眼圖交叉點調制)，無需外部微處理器和外部元件。 　　EP116采用無鉛、6mm*6mm、48引腳QFN封裝。 　　特點： 　　3.3供電時，功耗僅為500mW 　　工作速率高達10.32Gbps 　　10.32Gbps下，具有5mVp-p接收靈敏度 　　Rx和Tx極性選擇 　　可調節觸發LOS報警電平 　　LOS極性選擇 　　能夠向100歐姆差分負載提供高達12mA的調制電流 　　偏置電流高達19mA 　　Rx輸出可選擇去加重 　　支持SPI EEPROM和IIC EEPROM 　　可調節調制輸出的眼圖交叉點 　　工作溫度: -40度 到 90度

本實用新型一種十字滑塊式塞拉門機構涉及的是一種高速列車塞拉門的開關與密封機構，特別適用于 地鐵或者高速列車的門的開關與密封。由步進電機、絲杠、絲杠螺母、支座、主軸、十字滑塊、導桿、塞 拉門體、導向輪、導向槽組成；主軸固定在支座上，十字滑塊的其中一個孔與主軸配合并能延主軸滑動， 十字滑塊的另一個相互垂直的孔與導桿相配合，塞拉門體與該導桿用螺釘固聯，在導桿上裝有導向輪，導 向輪限制在導向槽內運動，導向槽做成直線加圓弧的形狀；其中十字滑塊的運動是通過步進電機驅動絲杠 15 旋轉，使絲杠螺母作直線移動，絲杠螺母與十字滑塊固聯。所述絲杠螺母與十字滑塊通過連桿用螺釘固聯。 所述十字滑塊至少設置有一個。

針對生化芯片加工新技術,根據生化樣品特征，按照整體、高效設計，制備 出生化芯片，具有適應面廣、直觀，無創，高效等優點，在生物醫學、食品安全 生化芯片加工等方面都具有廣泛的應用前景。

成果介紹人體器官芯片的成功研發將有力推動我國生物醫療用芯片制造技術的發展，建立全新的生命科學實驗方法；能夠有效減少新藥研發等對動物和臨床實驗的依賴，加速新藥研發的流程并減少研發投入技術創新點及參數微縮人工器官，以實現對人體器官功能的模擬。器官芯片高內涵裝置的設計和制造，開發了標準芯片系統及器官特異性生物材料市場前景疾病模型，藥物評估，個性化醫療。

一、領航一號 JFM7101 基帶處理集成電路采用 SOC 設計,支持 10 路獨立接收通道和 1 路發送通道,內部集成高性能 16 位數字信號處理器,支持多種通信接口,可實現北斗一代衛星 信號的接收與發送、出入站協議處理及接口通信等功能; 二、領航二號 JFM7201 基帶處理集成電路 支持北斗二號B3、B1頻點/GPS-L1頻點信號的捕獲跟

GaN系列材料具有低的熱產生率和高擊穿電場，是制作大功率電子器件的重要材料。利用GaN材料制造的功率管擁有承受大電流、耐高壓、抗輻射，耐高溫而且開關速度快的特點，非常適用于高功率微波器件。隨著5G毫米波通信、工業4.0和新一代雷達的發展，這種功率微波器件將會得到更廣泛的應用。但是，對于這種半導體器件的負載開關驅動提出了非常高的要求。要求負載開關驅動封裝尺寸小，便于大陣列集成。并且對可靠行的要求也極高。智能功率集成電路（Smart Power Inte

交流伺服系統是跨行業、量大面廣、節能效果顯著的節能機電產品，幾乎滲透到所有用機電領域，是工業、農業和國防建設及人民生活、正常生產和安全工作的重要保證。

1.痛點問題 元宇宙時代三維成像基礎設備和數字終端成像及顯示設備都將需要革命性的提升。同時，工業智能和基礎科學的快速發展也對感知和成像極限提出了更高的需求。 現有的成像技術，即攝像頭模組和3D成像模組，存在諸多技術和經濟的缺陷，如抗擾動性能差、占據空間大、功耗大、成本高等，特別是隨著傳感芯片像素數的增加，傳統光學成像系統需要多級較大的昂貴鏡片才能實現高分辨率的成像性能，很難應用于手機等小型化設備上，不足以適應科技的高速發展。 “智能視覺感知芯片”將達成光學感知的技術革新并有效解決現存問題。通過數字自適應光學技術矯正系統像差和環境像差、實現高速重構目標景物高精度三維信息，進而實現使用普通的低成本小型化單鏡片即可實現高分辨率成像，同時該芯片能夠適用于不同的光學系統，包括大口徑天文成像，實現高分辨率遠距離成像，克服大氣湍流干擾。 2.解決方案 團隊提出“智能視覺感知芯片”概念，該種芯片擁有多項優勢：全球領先的4D感知技術，自適應抗干擾；創新的透鏡設計方案結合自主知識產權算法，可通過單攝像頭模組實現原多攝像頭模組功能，大幅降低現有成本、體積和功耗，顯著提升分辨率。通過對目標場景進行多維度的密集采樣，將多維度的耦合信息解耦，重構傅里葉面的非期望相位分布，實現高速大范圍的自適應光學矯正，顯著降低光學成像系統尺寸與成本，提升成像效果，同時具備三維深度感知能力。 合作需求 尋求消費電子等領域有相關技術開發、市場推廣經驗，能推廣本技術落地的高科技企業，可以進行深度合作。

1. 痛點問題 元宇宙時代三維成像基礎設備和數字終端成像及顯示設備都將需要革命性的提升。同時，工業智能和基礎科學的快速發展也對感知和成像極限提出了更高的需求。 現有的成像技術，即攝像頭模組和3D成像模組，存在諸多技術和經濟的缺陷，如抗擾動性能差、占據空間大、功耗大、成本高等，特別是隨著傳感芯片像素數的增加，傳統光學成像系統需要多級較大的昂貴鏡片才能實現高分辨率的成像性能，很難應用于手機等小型化設備上，不足以適應科技的高速發展。 “智能視覺感知芯片”將達成光學感知的技術革新并有效解決現存問題。通過數字自適應光學技術矯正系統像差和環境像差、實現高速重構目標景物高精度三維信息，進而實現使用普通的低成本小型化單鏡片即可實現高分辨率成像，同時該芯片能夠適用于不同的光學系統，包括大口徑天文成像，實現高分辨率遠距離成像，克服大氣湍流干擾。 2. 解決方案 團隊提出“智能視覺感知芯片”概念，該種芯片擁有多項優勢：全球領先的4D感知技術，自適應抗干擾；創新的透鏡設計方案結合自主知識產權算法，可通過單攝像頭模組實現原多攝像頭模組功能，大幅降低現有成本、體積和功耗，顯著提升分辨率。通過對目標場景進行多維度的密集采樣，將多維度的耦合信息解耦，重構傅里葉面的非期望相位分布，實現高速大范圍的自適應光學矯正，顯著降低光學成像系統尺寸與成本，提升成像效果，同時具備三維深度感知能力。 合作需求 尋求消費電子等領域有相關技術開發、市場推廣經驗，能推廣本技術落地的高科技企業，可以進行深度合作。

作為信息化時代各領域發展的重要基礎與保障，信息安全是一個不容忽視的國家安全戰略。當今信息安全領域廣泛使用的公鑰密碼體制主要都是基于經典計算機“難以求解”的數學問題所設計構造的。近些年來，隨著量子計算技術的快速發展，傳統公鑰密碼體制不再安全。一方面，Shor算法、Grover搜索算法、量子傅里葉變換等算法相繼被提出，從理論上證明這些算法在量子計算機上運行可以顯著縮短傳統公鑰密碼體制所依賴數學問題的求解時間。另一方面，實際可行的量子計算機技術不斷發展，2019年，Google宣布制造出53量子比特的量子處理器“懸鈴木”，在絕對零度條件下可以在200秒完成超級計算機1萬年的計算任務。在即將到來的“后量子時代”，我們需要更安全的密碼體制來保護隱私，也就是后量子密碼（Post-QuantumCryptography,PQC）。未來10年商用量子計算機將面世，在量子計算機面前，構造傳統公鑰密碼體制所基于的數學難題將毫無安全性可言，進而依賴密碼體制而構建的信息安全系統及各種應用將面臨著嚴峻的安全問題，甚至存在被完全破解的潛在威脅，亟待研究抵御量子攻擊的密碼體制及其芯片實現技術。 2022年美國政府正式簽署安全法案，首次將后量子密碼納入美國國家安全備忘錄，同時還提出《量子計算網絡安全準備度法案》，旨在指導推動信息安全系統向后量子密碼學過渡。2022年9月7日，美國國家安全局(NSA)發布了《商業國家安全算法套件2.0》，其中將入選第三輪抗量子密碼標準化選擇的CRYSTALS-KYBER(以下簡稱Kyber)算法列為國家安全系統未來過渡遷移的必備算法。我國也在后量子密碼領域積極跟進，參與國際競爭，于2020年發布國內首份量子安全白皮書，廣泛布局后量子密碼安全技術應用與產業生態。目前后量子密碼算法的研究正在逐漸走向成熟與標準化，未來將有數十億新舊設備完成從傳統公鑰密碼體制向后量子密碼算法的遷移過程。在充分考慮安全性能、算法性能、便利性和合規性的前提下，研制出符合國際標準且具有國際競爭力的后量子密碼SoC芯片并應用，對于我國加快搶占后量子密碼國際領先地位，保障量子時代下的信息安全具有重要意義。 圖1 后量子密碼在未來信息安全領域的應用 本成果提出一種應用在云計算、數據中心加密中的高性能隨機數生成哈希核心算子，實現了具有靈活性和高吞吐量的可配置Keccak核心。該核心可配置為支持多個采樣策略，通過高吞吐量隨機數擴展發生器新型結構達到11.7Gbps的吞吐率，性能表現為目前世界最高水平。 圖2 高性能后量子密碼哈希核心算子 在國際上首次提出了具有側信道SPA攻擊防御機制的可配置BS-CDT高斯采樣器。該設計基于CDT反演高斯采樣算法，通過真隨機數發生器和隨機化功耗特性的電路結構，采取隱藏相關數據的防御機制，高效獲取安全性更好的均勻分布隨機數，并可以有效抵御時間攻擊和潛在的功耗分析攻擊，顯著提高安全性。電路采樣精度可達112bit，新型多級快速查找表結構極大縮短了概率函數分布表搜索時間，性能相較于同類設計提升近18倍。解決了高精度需求與采樣速度不匹配的沖突問題，優化了概率函數分布表的存儲資源，靈活劃分密碼系統中的高斯采樣值，并有效加固了后量子密碼系統數據前級的側信道安全性。 圖3 多模域計算兼容可重構算術單元 針對后量子密碼計算量大，數據復雜的痛難點，優化格數學難題中的數論變換（NTT）算法，實現了一種高性能NTT硬件加速單元。采用雙倍位寬乒乓式對稱存儲結構突破訪存限制，改進模乘運算單元關鍵結構，提高多項式運算的效率，相比同類運算操作下最先進的設計快3.95倍。 圖4 靈活指令集型后量子密碼安全處理器芯片架構及版圖 針對后量子密碼算法的多樣化計算需求，創新性地提出了一種多模域計算兼容型可重構核心算子，能夠配置為不同模域下的關鍵運算結構，靈活支持Karatsuba、Toeplitz、NTT等運算結構。在配置為NTT結構的運算下，運算性能與美國MIT研究團隊在IEEEISSCC發表的相關成果保持國際同步水平，并具備更強的靈活性與通用性。 圖5 多模域計算兼容型可重構核心算子 在團隊積累多年的后量子密碼相關先進技術研究的基礎上，在SMIC40nm工藝下實現了兩款后量子密碼芯片，能夠兼容國際最新標準的CRYSTAL-Kyber后量子密碼算法。后量子密碼Kyber芯片采用了高性能流水線結構的蝶形運算單元及高速NTT運算單元，解決了加解密運算中訪問存儲器所帶來的速度瓶頸問題。靈活指令集型后量子密碼芯片采用可編程自定義指令集架構，基于多模域計算兼容的可重構算術單元與可配置多功能哈希/隨機采樣核心算子，在實現高性能的后量子密碼運算的同時提高了芯片的靈活性與適應性。 圖6 后量子密碼Kyber處理器芯片架構及版圖 圖7 靈活指令集型后量子密碼處理器芯片架構及版圖